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<H1>www.duv24.net : Leiterplatten-Design-Tool</H1>
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> <B><FONT color="#CC3300">Nachrichten</FONT></B></TD>
<TD ALIGN=right VALIGN=bottom CLASS=detailDatum>17.05.2004</TD>
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<TD CLASS=detailBildunterschrift>Cadstar-SI-verify ermöglicht die Verifikation im GBit-Bereich</TD>
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Cadstar-SI-Verify von Zuken bietet effektive Simulations- und Verifikationsmöglichkeiten für Signalgeschwindigkeiten bis in den Gigabit-Bereich. Das Werkzeug nützt den Ansatz der Transmission-Line-Simulation, um Effekte wie Reflexionen und Übersprechen zu analysieren. Gleichzeitig ermöglicht es die Analyse des echten Verbindungs-Timings und von Verzögerungszeiten. Das Tool ist mit einem graphischen Scenario-Editor, einer Layer-Stack-Definition für die Optimierung von Impedanzen und Lagen, einer EMV-Bauteilebibliothek und der Option für eine interaktive oder Batch-Simulation ausgestattet. Damit ist eine FFT-Analyse auf Zeit- oder Frequenzbasis möglich. Das Werkzeug bietet eine ausgeklügelte Analyse von Übersprecheffekten und die Möglichkeit, die Abstände der Leiterbahnen zu optimieren. Mit dem Tool können auch differenzielle Signale oder PECL-Logik simuliert werden. Ein Parameter-Sweep hilft dabei, die idealen Werte der passiven Komponenten oder die Längen der Übertragungsleitungen zu bestimmen, um die gewünschte elektrische Leistung der Netze zu erreichen.</TD>
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<P><I>Diese Seite wurde am 25.09.2004, 13:14 Uhr aktualisiert</I></P>
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