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<H1>www.duv24.net : M. Reuter: "Auswege aus dem Engpass der Verifikation"</H1>
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<TD VALIGN=TOP CLASS=detailBereichRedaktion>Bereich >
Redaktion
> <B><FONT color="#CC3300">Fachbeiträge</FONT></B></TD>
<TD ALIGN=right VALIGN=bottom CLASS=detailDatum>15.04.2004</TD>
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<TD VALIGN=top CLASS=detailFirma ID=topSpace>Mentor Graphics :</TD>
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<TD VALIGN=top CLASS=detailTitel>M. Reuter: "Auswege aus dem Engpass der Verifikation"</TD>
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<TD VALIGN=top CLASS=detailSubtitel>Die vielfachen Dimensionen der Skalierbarkeit einer Systemverifikationsstrategie</TD>
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<TD CLASS=detailBildunterschrift>Eine skalierbare Verifikationsumgebung umfasst den kompletten Entwurfsprozess</TD>
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Die funktionale Verifikation ist heute eine der größten Herausforderungen für Elektronik-Designer, da die Komplexität der Gesamtsysteme wächst und Produkte mit immer größerer Funktionalität ausgestattet werden. Das Problem der bestehenden Entwurfs- und Verifikationsmethoden liegt darin, dass die Verifikation dem Entwurf gegenüber eine zweitrangige Rolle spielt. Dies muss sich ändern, denn die funktionale Verifikation, als der zum Auffinden von Funktionsfehlern verwendete Prozess, stellt den größten Engpass im Ablauf des Entwurfsprozesses dar. <a href="http://www.duv24.net/media/design-verification/dvapr2004/dv044252.pdf" target="_blank">Vollbeitrag als PDF</a></TD>
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<P><I>Diese Seite wurde am 25.09.2004, 13:13 Uhr aktualisiert</I></P>
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